零件编号 | SI4112-D-GTR |
---|---|
制造商 | Silicon Labs |
描述 | IC SYNTHESIZER IF ONLY 24TSSOP |
数据表 | |
封装 | 24-TSSOP (0.173", 4.40mm Width) |
ECAD | |
库存 | 5,472 piece(s) |
单价 | $ 3.7999 * |
交货时间 | 待确认 |
预计送达时间 | 十一月 17 - 十一月 22 (选择速递服务) |
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零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GTR D# V36:1790_06538040 |
Silicon Laboratories Inc |
RF Synthesizer with IF OUs RoHS: Compliant
|
0 |
SI4112-D-GT D# V99:2348_06538038 |
Silicon Laboratories Inc |
RF Synthesizer with IF OUs RoHS: Compliant
|
0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GTR |
Silicon Laboratories Inc |
IC SYNTHESIZER IF ONLY 24TSSOP |
0 |
SI4112-D-GT |
Silicon Laboratories Inc |
IC SYNTHESIZER IF ONLY 24TSSOP |
0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GTR D# SI4112-D-GTR-ND |
Silicon Laboratories Inc |
IC SYNTHESIZER IF ONLY 24TSSOP |
0 |
SI4112-D-GT D# 336-1171-ND |
Silicon Laboratories Inc |
IC SYNTHESIZER IF ONLY 24TSSOP |
1054 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# 3387050 |
Silicon Laboratories Inc |
DUAL-BAND RF SYNTHESIZER, -40 TO 85DEG C RoHS: Compliant
Min Qty: 1
Container: Each
|
0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# 634-SI4112-D-GT |
Silicon Laboratories Inc |
Phase Locked Loops - PLL RF Synthesizer with IF output RoHS: Compliant
|
182 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# 66AH6972 |
Silicon Laboratories Inc |
DUAL-BAND RF SYNTHESIZER, -40 TO 85DEG C ROHS COMPLIANT: YES RoHS: Compliant
Min Qty: 1
Container: Bulk
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0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# NS-SI4112-D-GT |
Silicon Laboratories Inc |
OEM/CM ONLY |
4823 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT |
Silicon Laboratories Inc |
PHASE LOCKED LOOP, PDSO24 |
6 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GTR |
Silicon Laboratories Inc |
IF Synthesizer IF Only, lead free |
0 |
SI4112-D-GT |
Silicon Laboratories Inc |
IF Synthesizer IF Only, lead free |
0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# 31396691 |
Silicon Laboratories Inc |
RF Synthesizer with IF OUs RoHS: Compliant
|
0 |
零件编号 | 制造商 | 描述 | 库存 |
SI4112-D-GT D# 3387050 |
Silicon Laboratories Inc |
DUAL-BAND RF SYNTHESIZER, -40 TO 85DEG C RoHS: Compliant
Min Qty: 1
Container: Each
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0 |
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